IMPLEMENTACIÓN DE UNA ARQUITECTURA DE NÚCLEO RISC DE 32 BITS DE ALTO RENDIMIENTO

Lingua: spagnolo

Editore: Ediciones Nuestro Conocimiento, 2023

6206245535 / 9786206245537

Da: AHA-BUCH GmbH, Einbeck, GermaniaAHA-BUCH GmbH

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nach der Bestellung gedruckt Neuware - Printed after ordering - Este libro trata sobre el diseño de un procesador RISC utilizando arquitectura pipelining. El pipelining de 5 etapas se utiliza para mejorar la velocidad de la operación. Las 5 etapas son Fetch, Decode, Execute, Memory y Write Back. El proceso de diseño incluye varias técnicas de bajo consumo a nivel arquitectónico que demuestran que estos métodos son más eficientes que las técnicas de reducción de consumo de Back-end. Los procesadores embebidos de bajo consumo se utilizan en una gran variedad de aplicaciones, como coches, teléfonos, cámaras digitales, impresoras y otros dispositivos similares. La razón de su amplio uso es que son pequeños, por lo que no ocupan mucha superficie y su fabricación es rentable. El bajo consumo de energía ayuda a reducir la disipación de calor, alargar la vida de la batería y aumentar la fiabilidad del dispositivo.

Codice articolo 9786206245537

Titolo
IMPLEMENTACIÓN DE UNA ARQUITECTURA DE NÚCLEO RISC DE 32 BITS DE ALTO RENDIMIENTO
Autore
M. Rajani
Editore
Ediciones Nuestro Conocimiento
Anno di pubblicazione
2023
Condizione
Neu
Rilegatura
Taschenbuch
Lingua
spagnolo
ISBN 10
6206245535
ISBN 13
9786206245537
Peso dell'articolo
137 grammi
Dimensioni
220x150x5 mm

AHA-BUCH GmbH

Einbeck, Germania

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