Power Management of Digital Circuits in Deep Sub-Micron CMOS Technologies
Lingua: inglese
Editore: Springer Netherlands Nov 2010, 2010
Serie: Libro 11 di 72 - Springer Series in Advanced Microelectronics
- Brossura
- Nuovo
Da: BuchWeltWeit Ludwig Meier e.K., Bergisch Gladbach, GermaniaBuchWeltWeit Ludwig Meier e.K.
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This item is printed on demand - it takes 3-4 days longer - Neuware -This book provides an in-depth overview of design and implementation of leakage reduction techniques. The focus is on applicability, technology dependencies, and scalability. The book mainly deals with circuit design but also addresses the interface between circuit and system level design on the one side and between circuit and physical design on the other side. 204 pp. Englisch.
Codice articolo 9789048172788
- Titolo
- Power Management of Digital Circuits in Deep Sub-Micron CMOS Technologies
- Autore
- Stephan Henzler
- Editore
- Springer Netherlands Nov 2010
- Anno di pubblicazione
- 2010
- Condizione
- Neu
- Rilegatura
- Taschenbuch
- Lingua
- inglese
- ISBN 10
- 9048172780
- ISBN 13
- 9789048172788
- Peso dell'articolo
- 318 grammi
- Dimensioni
- 235x155x12 mm
- Serie
- Libro 11 di 72: Springer Series in Advanced Microelectronics
In the deep sub-micron regime, the power consumption has become one of the most important issues for competitive design of digital circuits. Due to dramatically increasing leakage currents, the power consumption does not take advantage of technology scaling as before. State-of-art power reduction techniques like the use of multiple supply and threshold voltages, transistor stack forcing and power gating are discussed with respect to implementation and power saving capability. Focus is given especially on technology dependencies, process variations and technology scaling. Design and implementation issues are discussed with respect to the trade-off between power reduction, performance degradation, and system level constraints. A complete top-down design flow is demonstrated for power gating techniques introducing new design methodologies for the switch sizing task and circuit blocks for data-retention and block activation. The leakage reduction ratio and the minimum power-down time are introduced as figures of merit to describe the power gating technique on system level and give a relation to physical circuit parameters. Power Management of Digital Circuits in Deep Sub-Micron CMOS Technologies mainly deals with circuit design but also addresses the interface between circuit and system level design on the one side and between circuit and physical design on the other side.
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