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9781402084492 - Low-Power High-Speed ADCs for Nanometer CMOS Integration di Cao, Zhiheng; Yan, Shouli (14 risultati)
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Low-power High-speed Adcs For Nanometer Cmos Integration
Libro 12 di 124: Analog Circuits and Signal ProcessingDa: Romtrade Corp., STERLING HEIGHTS, MI, U.S.A.
Valutazione del venditore 5 su 5 stelle
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Low-power High-speed Adcs For Nanometer Cmos Integration
Libro 12 di 124: Analog Circuits and Signal ProcessingDa: Basi6 International, Irving, TX, U.S.A.
Valutazione del venditore 5 su 5 stelle
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Low-Power High-Speed ADCs for Nanometer CMOS Integration
Libro 12 di 124: Analog Circuits and Signal ProcessingDa: GreatBookPrices, Columbia, MD, U.S.A.
Valutazione del venditore 5 su 5 stelle
EUR 116,64
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Low-Power High-Speed ADCs for Nanometer CMOS Integration (Analog Circuits and Signal Processing)
Libro 12 di 124: Analog Circuits and Signal ProcessingDa: California Books, Miami, FL, U.S.A.
Valutazione del venditore 4 su 5 stelle
EUR 119,03
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Low-Power High-Speed ADCs for Nanometer CMOS Integration (Analog Circuits and Signal Processing)
Libro 12 di 124: Analog Circuits and Signal ProcessingDa: Ria Christie Collections, Uxbridge, Regno Unito
Valutazione del venditore 5 su 5 stelle
EUR 116,53
Spedizione EUR 13,99
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Low-Power High-Speed ADCs for Nanometer CMOS Integration
Libro 12 di 124: Analog Circuits and Signal ProcessingDa: GreatBookPricesUK, Woodford Green, Regno Unito
Valutazione del venditore 5 su 5 stelle
EUR 116,51
Spedizione EUR 17,52
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Low-Power High-Speed Adcs for Nanometer CMOS Integration
Libro 12 di 124: Analog Circuits and Signal ProcessingEUR 112,77
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Aggiungi al carrelloBuch. Condizione: Neu. Druck auf Anfrage Neuware - Printed after ordering - Low-Power High-Speed ADCs for Nanometer CMOS Integrationis about the design and implementation of ADC in nanometer CMOS processes that achieve lower power consumption for a given speed and resolution than previous designs, through architectural and circuit innovations that take advantage of unique features of nanometer CMOS processes. A phase lock loop (PLL) clock multiplier has also been designed using new circuit techniques and successfully tested. 1) A 1.2V, 52mW, 210MS/s 10-bit two-step ADC in 130nm CMOS occupying 0.38mm2. Using offset canceling comparators and capacitor networks implemented with small value interconnect capacitors to replace resistor ladder/multiplexer in conventional sub-ranging ADCs, it achieves 74dB SFDR for 10MHz and 71dB SFDR for 100MHz input.2) A 32mW, 1.25GS/s 6-bit ADC with 2.5GHz internal clock in 130nm CMOS. A new type of architecture that combines flash and SAR enables the lowest power consumption, 6-bit >1GS/s ADC reported to date. This design can be a drop-in replacement for existing flash ADCs since it does require any post-processing or calibration step and has the same latency as flash. 3) A 0.4ps-rms-jitter (integrated from 3kHz to 300MHz offset for >2.5GHz) 1-3GHz tunable, phase-noise programmable clock-multiplier PLL for generating sampling clock to the SAR ADC. A new loop filter structure enables phase error preamplification to lower PLL in-band noise without increasing loop filter capacitor size.
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Low-Power High-Speed ADCs for Nanometer CMOS Integration
Libro 12 di 124: Analog Circuits and Signal ProcessingDa: GreatBookPricesUK, Woodford Green, Regno Unito
Valutazione del venditore 5 su 5 stelle
EUR 199,64
Spedizione EUR 17,52
Spedito da Regno Unito a U.S.A.Quantità: Più di 20 disponibili
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Low-Power High-Speed ADCs for Nanometer CMOS Integration (Analog Circuits and Signal Processing)
Libro 12 di 124: Analog Circuits and Signal ProcessingDa: Mispah books, Redhill, SURRE, Regno Unito
Valutazione del venditore 4 su 5 stelle
EUR 190,03
Spedizione EUR 29,19
Spedito da Regno Unito a U.S.A.Quantità: 1 disponibili
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Low-Power High-Speed ADCs for Nanometer CMOS Integration
Libro 12 di 124: Analog Circuits and Signal ProcessingDa: GreatBookPrices, Columbia, MD, U.S.A.
Valutazione del venditore 5 su 5 stelle
EUR 222,41
Spedizione EUR 2,31
Spedito in U.S.A.Quantità: Più di 20 disponibili
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Low-Power High-Speed ADCs for Nanometer CMOS Integration (eng)
Libro 12 di 124: Analog Circuits and Signal ProcessingDa: Brook Bookstore On Demand, Napoli, NA, Italia
Valutazione del venditore 5 su 5 stelle
EUR 86,24
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Low-Power High-Speed Adcs for Nanometer CMOS Integration
Libro 12 di 124: Analog Circuits and Signal ProcessingDa: BuchWeltWeit Ludwig Meier e.K., Bergisch Gladbach, Germania
Valutazione del venditore 5 su 5 stelle
EUR 106,99
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Aggiungi al carrelloBuch. Condizione: Neu. This item is printed on demand - it takes 3-4 days longer - Neuware -Low-Power High-Speed ADCs for Nanometer CMOS Integrationis about the design and implementation of ADC in nanometer CMOS processes that achieve lower power consumption for a given speed and resolution than previous designs, through architectural and circuit innovations that take advantage of unique features of nanometer CMOS processes. A phase lock loop (PLL) clock multiplier has also been designed using new circuit techniques and successfully tested. 1) A 1.2V, 52mW, 210MS/s 10-bit two-step ADC in 130nm CMOS occupying 0.38mm2. Using offset canceling comparators and capacitor networks implemented with small value interconnect capacitors to replace resistor ladder/multiplexer in conventional sub-ranging ADCs, it achieves 74dB SFDR for 10MHz and 71dB SFDR for 100MHz input.2) A 32mW, 1.25GS/s 6-bit ADC with 2.5GHz internal clock in 130nm CMOS. A new type of architecture that combines flash and SAR enables the lowest power consumption, 6-bit >1GS/s ADC reported to date. This design can be a drop-in replacement for existing flash ADCs since it does require any post-processing or calibration step and has the same latency as flash. 3) A 0.4ps-rms-jitter (integrated from 3kHz to 300MHz offset for >2.5GHz) 1-3GHz tunable, phase-noise programmable clock-multiplier PLL for generating sampling clock to the SAR ADC. A new loop filter structure enables phase error preamplification to lower PLL in-band noise without increasing loop filter capacitor size. 95 pp. Englisch.
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Low-Power High-Speed ADCs for Nanometer CMOS Integration
Libro 12 di 124: Analog Circuits and Signal ProcessingEUR 93,00
Spedizione EUR 48,99
Spedito da Germania a U.S.A.Quantità: Più di 20 disponibili
Aggiungi al carrelloCondizione: New. Dieser Artikel ist ein Print on Demand Artikel und wird nach Ihrer Bestellung fuer Sie gedruckt. Implementation detail of three state-of-the-art low-power high-performance ADC and clock multiplier PLL designs using unique architecturesConcise and graphical explanation of key points in ADC/PLL design at both architecture and circuit level.
