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Design of Cost-Efficient Interconnect Processing Units : Spidergon STNoC
Coppola, Marcello; Grammatikakis, Miltos D.; Locatelli, Riccardo; Maruccia, Giuseppe; Pieralisi, Lorenzo
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Design of Cost-Efficient Interconnect Processing Units
Lorenzo Pieralisi Giuseppe Maruccia Riccardo Locatelli Miltos D. Grammatikakis Marcello Coppola
Lingua: Inglese
Editore: Taylor & Francis Group, 2008
Serie: Libro 1 di 2 - System-on-Chip Design and Technologies
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Editore: Taylor & Francis Inc, 2008
Serie: Libro 1 di 2 - System-on-Chip Design and Technologies
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Editore: Taylor & Francis Inc Sep 2008, 2008
Serie: Libro 1 di 2 - System-on-Chip Design and Technologies
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Buch. Condizione: Neu. Neuware - Written by leading experts in the field, Design of Cost-Efficient Interconnect Processing Units: 'Spidergon STNoC' comprehensively examines the current state-of-the-art and future trends in multiprocessor system-on-chip (MPSoC), in particular network-on-chip (NoC) design. Incorporating simple methods with easy-to-understand examples, this book considers a wealth of important theoretical and practical topics, such as technological deep sub-micron effects, generic NoC components, topological properties, embeddings of common communication patterns, and system-level design. A complementary CD-ROM features a practical NoC training approach based on the award-winning OCCN environment. …
Design of Cost-Efficient Interconnect Processing Units
Pieralisi Lorenzo Maruccia Giuseppe Locatelli Riccardo Grammatikakis Miltos D. Coppola Marcello
Lingua: Inglese
Editore: Taylor & Francis Group, 2008
Serie: Libro 1 di 2 - System-on-Chip Design and Technologies
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Design of Cost-Efficient Interconnect Processing Units
Pieralisi Lorenzo Maruccia Giuseppe Locatelli Riccardo Grammatikakis Miltos D. Coppola Marcello
Lingua: Inglese
Editore: Taylor & Francis Group, 2008
Serie: Libro 1 di 2 - System-on-Chip Design and Technologies
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