9786204286440 - simulation de la conception structurelle d'un protocole de bus haute performance avancé di choubey, shruti bhargava; choubey, abhishek; singh kurmi, rishabh (5 risultati)
Simulation de la conception structurelle d\ un protocole de bus haute performance avancé
Choubey, Shruti Bhargava|Choubey, Abhishek|Singh Kurmi, Rishabh
- Brossura
Da: moluna, Greven, , Germaniamoluna
Contatta il venditoreVenditore con 5 stelleCondizione: Nuovo
EUR 34,25
EUR 48,99 spedizioneSpedito da Germania a U.S.A.Quantità: Più di 20 disponibili
Condizione: New.
- Brossura
Da: preigu, Osnabrück, Germaniapreigu
Contatta il venditoreVenditore con 5 stelleCondizione: Nuovo
EUR 36,25
EUR 70,00 spedizioneSpedito da Germania a U.S.A.Quantità: 5 disponibili
Taschenbuch. Condizione: Neu. Simulation de la conception structurelle d'un protocole de bus haute performance avancé | Shruti Bhargava Choubey (u. a.) | Taschenbuch | Französisch | 2021 | Editions Notre Savoir | EAN 9786204286440 | Verantwortliche Person für die EU: preigu GmbH & Co. KG, Lengericher Landstr. 19, 49078 Osnabrück…, mail[at]preigu[dot]de | Anbieter: preigu.
- Brossura
- Print on Demand
Da: BuchWeltWeit Ludwig Meier e.K., Bergisch Gladbach, , GermaniaBuchWeltWeit Ludwig Meier e.K.
Contatta il venditoreVenditore con 5 stelleCondizione: Nuovo
EUR 39,90
EUR 23,00 spedizioneSpedito da Germania a U.S.A.Quantità: 2 disponibili
Taschenbuch. Condizione: Neu. This item is printed on demand - it takes 3-4 days longer - Neuware -Les problèmes actuels dans les industries sont dus à l'absence de transfert de données approprié entre les coeurs IP sur le système sur puce (SOC). Ces derniers jours, le développement des puces SOC et des noyaux IP réutilisables a… reçu une priorité plus élevée en raison de son moindre coût et de la réduction de la période de mise sur le marché. C'est ainsi que se pose la question majeure et très sensible de l'interfaçage de ces coeurs IP. Ces interfaces jouent un rôle vital dans le SOC et doivent être soignées en raison de la communication entre les propriétés des coeurs IP. La communication entre les différents coeurs IP doit avoir un flux de données sans perte et doit également être flexible pour le concepteur. Pour résoudre ce problème, les bus de protocole standard sont utilisés afin d'interfacer les deux noyaux IP. Ici, la perte de données dépend des normes des protocoles utilisés. La plupart des coeurs IP d'ARM utilisent l'AMBA (Advanced Micro controller Bus Architecture) qui possède le AHB (Advanced High-Performance Bus). Ce bus a ses propres avantages et sa propre flexibilité. Une interface AHB complète est utilisée pour les maîtres de bus, les blocs de mémoire sur puce, les interfaces de mémoire externe, les périphériques à large bande passante avec interfaces FIFO et les périphériques esclaves DMA. 76 pp. Französisch.
- Brossura
- Print on Demand
Da: buchversandmimpf2000, Emtmannsberg, BAYE, Germaniabuchversandmimpf2000
Contatta il venditoreVenditore con 5 stelleCondizione: Nuovo
EUR 39,90
EUR 60,00 spedizioneSpedito da Germania a U.S.A.Quantità: 1 disponibili
Taschenbuch. Condizione: Neu. This item is printed on demand - Print on Demand Titel. Neuware -Les problèmes actuels dans les industries sont dus à l'absence de transfert de données approprié entre les curs IP sur le système sur puce (SOC). Ces derniers jours, le développement des puces SOC et des noyaux IP réutilisables a reçu…une priorité plus élevée en raison de son moindre coût et de la réduction de la période de mise sur le marché. C'est ainsi que se pose la question majeure et très sensible de l'interfaçage de ces curs IP. Ces interfaces jouent un rôle vital dans le SOC et doivent être soignées en raison de la communication entre les propriétés des curs IP. La communication entre les différents curs IP doit avoir un flux de données sans perte et doit également être flexible pour le concepteur. Pour résoudre ce problème, les bus de protocole standard sont utilisés afin d'interfacer les deux noyaux IP. Ici, la perte de données dépend des normes des protocoles utilisés. La plupart des curs IP d'ARM utilisent l'AMBA (Advanced Micro controller Bus Architecture) qui possède le AHB (Advanced High-Performance Bus). Ce bus a ses propres avantages et sa propre flexibilité. Une interface AHB complète est utilisée pour les maîtres de bus, les blocs de mémoire sur puce, les interfaces de mémoire externe, les périphériques à large bande passante avec interfaces FIFO et les périphériques esclaves DMA.VDM Verlag, Dudweiler Landstraße 99, 66123 Saarbrücken 76 pp. Französisch.
- Brossura
- Print on Demand
Da: AHA-BUCH GmbH, Einbeck, GermaniaAHA-BUCH GmbH
Contatta il venditoreVenditore con 5 stelleCondizione: Nuovo
EUR 40,89
EUR 60,66 spedizioneSpedito da Germania a U.S.A.Quantità: 1 disponibili
Taschenbuch. Condizione: Neu. nach der Bestellung gedruckt Neuware - Printed after ordering - Les problèmes actuels dans les industries sont dus à l'absence de transfert de données approprié entre les coeurs IP sur le système sur puce (SOC). Ces derniers jours, le développement des puces SOC et des noyaux IP réutilisables a reçu… une priorité plus élevée en raison de son moindre coût et de la réduction de la période de mise sur le marché. C'est ainsi que se pose la question majeure et très sensible de l'interfaçage de ces coeurs IP. Ces interfaces jouent un rôle vital dans le SOC et doivent être soignées en raison de la communication entre les propriétés des coeurs IP. La communication entre les différents coeurs IP doit avoir un flux de données sans perte et doit également être flexible pour le concepteur. Pour résoudre ce problème, les bus de protocole standard sont utilisés afin d'interfacer les deux noyaux IP. Ici, la perte de données dépend des normes des protocoles utilisés. La plupart des coeurs IP d'ARM utilisent l'AMBA (Advanced Micro controller Bus Architecture) qui possède le AHB (Advanced High-Performance Bus). Ce bus a ses propres avantages et sa propre flexibilité. Une interface AHB complète est utilisée pour les maîtres de bus, les blocs de mémoire sur puce, les interfaces de mémoire externe, les périphériques à large bande passante avec interfaces FIFO et les périphériques esclaves DMA.
