Low Power Asynchronous Logic design for Viterbi Decoders

Lingua: inglese

Editore: LAP LAMBERT Academic Publishing Sep 2018, 2018

6139851297 / 9786139851294

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This item is printed on demand - it takes 3-4 days longer - Neuware -This book discusses the design of asynchronous logic and its importance in digital design. Most of the decoders designed and fabricated today are synchronous. The problem of clock skew is a major challenge in the synchronous design. Alternatively, asynchronous systems are becoming familiar as they are not in need of global clock, as these systems are locally synchronized by means of communication protocols. Asynchronous VLSI architecture for a Viterbi decoder is designed using Quasi Delay Insensitive (QDI) templates and Differential Cascode Voltage Switch Logic (DCVSL). It gives an overview of asynchronous implementation. 56 pp. Englisch.

Codice articolo 9786139851294

Titolo
Low Power Asynchronous Logic design for Viterbi Decoders
Autore
T. Kalavathi Devi Sakthivel
Editore
LAP LAMBERT Academic Publishing Sep 2018
Anno di pubblicazione
2018
Condizione
Neu
Rilegatura
Taschenbuch
Lingua
inglese
ISBN 10
6139851297
ISBN 13
9786139851294
Peso dell'articolo
102 grammi
Dimensioni
220x150x4 mm

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