Liu hsuan (30 risultati)
Lingua: Inglese
Editore: Cheng & Tsui Co (edition Traditional character ed), 1999
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Insights: The Wisdom and Compassion of a Buddhist Master: Q&A for Every Day
Venerable Master Hsuan Hua; Buddhist Text Translation Society
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Insights: The Wisdom and Compassion of a Buddhist Master: Q&A for Every Day
Venerable Master Hsuan Hua; Buddhist Text Translation Society
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Chinese Literature 10 1973 / Hsiao Kuan-hung "A Young Pathbreaker" / Chou Yung-chuang "Out to Learn" / Li Hui-hsin "The Girl in the Mountains" / Liu Yang and Hua Tung "Ideals in Life" / Cheng Hsuan and Yi Shih "A New Teacher"
Hsiao Kuan-hung "A Young Pathbreaker" / Chou Yung-chuang "Out to Learn" / Li Hui-hsin "The Girl in the Mountains" / Liu Yang and Hua Tung "Ideals in Life" / Cheng Hsuan and Yi Shih "A New Teacher"
Lingua: Inglese
Editore: Foreign Languages Press, Peking, 1973
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Soft cover. Condizione: Very Good. 102 pages. Illustrated. Hsiao Kuan-hung "A Young Pathbreaker" / Chou Yung-chuang "Out to Learn" / Li Hui-hsin "The Girl in the Mountains" / Liu Yang and Hua Tung "Ideals in Life" / Cheng Hsuan and Yi Shih "A New Teacher" (SL#282/1).
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Hardcover. Condizione: Brand New. 350 pages. 9.25x6.10x9.21 inches. In Stock.
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Taschenbuch. Condizione: Neu. Circuit-Technology Co-Optimization of SRAM Design in Advanced CMOS Nodes | Hsiao-Hsuan Liu (u. a.) | Taschenbuch | xviii | Englisch | 2025 | Springer | EAN 9783031761119 | Verantwortliche Person für die EU: Springer Verlag GmbH, Tiergartenstr. 17, 69121 Heidelberg, juergen[dot]hartmann[at]springer[d…ot]com | Anbieter: preigu.
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Lingua: Inglese
Editore: Springer, Berlin, Springer Nature Switzerland, Springer, 2024
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Buch. Condizione: Neu. This item is printed on demand - it takes 3-4 days longer - Neuware -Modern computing engines-CPUs, GPUs, and NPUs-require extensive SRAM for cache designs, driven by the increasing demand for higher density, performance, and energy efficiency. This book delves into two primary areas within ultra-scaled te…chnology nodes: (1) advancing SRAM bitcell scaling and (2) exploring innovative subarray designs to enhance power-performance-area (PPA) metrics across technology nodes.The first part of the book utilizes a bottom-up design-technology co-optimization (DTCO) approach, employing a dedicated PPA simulation framework to evaluate and identify the most promising strategies for SRAM bitcell scaling. It offers a comprehensive examination of SRAM bitcell scaling beyond 1 nm node, outlining a structured research cycle that includes identifying scaling bottlenecks, developing cutting-edge architectures with complementary field-effect transistor (CFET) technology, and addressing challenges such as process integration and routing complexities. Additionally, this book introduces a novel write margin methodology to better address the risks of write failures in resistance-dominated nodes. This methodology accounts for time-dependent parasitic bitline effects and incorporates timing setup of write-assist techniques to prevent underestimating the yield loss.In the second part, the focus shifts to a top-down DTCO approach due to the diminishing returns of bitcell scaling beyond 5 Å node at the macro level. As technology scales, increasing resistance and capacitance (RC) lead designers to adopt smaller subarray sizes to reduce effective RC and enhance subarray-level PPA. However, this approach can result in increased inter-subarray interconnect overhead, potentially offsetting macro-level improvements. This book examines the effects of various subarray sizes on macro-level PPA and finds that larger subarrays can significantly reduce interconnect overhead and improve the energy-delay-area product (EDAP) of SRAM macro. The introduction of the active interconnect (AIC) concept enables the use of larger subarray sizes, while integrating carbon nanotube FET as back-end-of-line compatible devices results in macro-level EDAP improvements of up to 65% when transitioning from standard subarrays to AIC divided subarrays. These findings highlight the future trajectory of SRAM subarray design in deeply scaled nodes. 288 pp. Englisch.
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Buch. Condizione: Neu. This item is printed on demand - Print on Demand Titel. Neuware -Modern computing engines-CPUs, GPUs, and NPUs-require extensive SRAM for cache designs, driven by the increasing demand for higher density, performance, and energy efficiency. This book delves into two primary areas within ultra-scaled techno…logy nodes: (1) advancing SRAM bitcell scaling and (2) exploring innovative subarray designs to enhance power-performance-area (PPA) metrics across technology nodes.Springer-Verlag KG, Sachsenplatz 4-6, 1201 Wien 308 pp. Englisch.
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